XC6SLX45-2CSG324I

Bitslip参考设计执行的功能与7 系列和Virtex-6 FPGA的ISERDES中嵌入的固有Bitslip功能相同，但是，该参考设计提供的一些额外选项是基于7 系列和Virtex-6 FPGA器件的解决方案中所没有的，因而超越了后者。当这个设计中的功能需要用在7系列或Virtex-6 FPGA设计中时，必须使用通用互联。因此，Bitslip参考设计可满足先前器件系列中Bitslip的要求和目标。

XAPP1203：在ZYNQ-7000 AP SOC上实现信号处理IP，以对XADC采样进行后处理

本应用指南是白皮书《在赛灵思All Programmable器件中有效实现模拟信号处理功能》(WP442)的后续配套文章，给出了简单易用的设计流程，以便利用赛灵思All Programmable抽象在赛灵思FPGA和All Programmable SoC中实现模拟信号处理功能。作者Mrinal J. Sarmah和Cathal Murphy在书中详细描述了如何利用白皮书中介绍的概念在Zynq-7000 All Programmable SoC上轻松构建信号处理IP核与完整的混合信号系统。

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