74HC193N PDF

集成电路(IC)>计数器，除法器>74HC系列/74HC(T)193参考数据

数据列表 74HC(T)193

产品相片 DIP16_SOT38-1 PKG

产品培训模块 Logic Packages

标准包装1,000 
类别 集成电路 (IC) 
家庭 逻辑 -计数器，除法器 
系列 74HC 
逻辑类型 二进制计数器 
方向 上，下 
元件数 1 
每个元件的位元数 4 
复位 异步 
计时 同步 
计数速率 49MHz 
触发器类型 正边沿 
电源电压 2 V ~ 6 V 
工作温度 -40°C ~ 125°C 
安装类型 通孔 
封装/外壳 16-DIP（0.300"，7.62mm） 
供应商设备封装 16-DIP 
包装 管件

产品说明

74年和74 hct193 hc193是高速si门CMOS设备和是销
符合低功率肖特基TTL(LSTTL)。他们是指定符合
JEDEC标准没有。7 a。
74年和74 hct193 hc193是4比特同步二进制向上或向下的计数器。单独
向上或向下的时钟,CPU和CPD,简化操作分别。输出变化状态
与由低向高跳变过渡的同步时钟输入或。如果CPU时钟
脉冲而CPD是高高举起,设备将数了。如果CPD时钟脉冲而
CPU是高高举起,设备将倒计时。只有一个时钟输入可以保持高
任何时间,或错误的操作将结果。该设备能在任何时间被清除的
异步主复位输入(MR);它也可能通过激活装载在并行的
异步并行加载输入(PL)。
74年和74 hct193 hc193每个包含四个主从JK的人字拖
必要的控制逻辑来提供异步复位、加载和同步计数
起来,倒计时功能。
每个触发器包含JK反馈从奴隶到主,这样一个由低向高跳变
过渡的CPD输入将减少计数,而类似的转变
CPU输入将推动一个计数。
一个时钟应该持有高而计数与其他,否则电路将
要么计数每两人或者没有,这就要取决于国家的个触发器,它不能
切换只要要么时钟输入很低。应用程序要求可逆操作
必须使换向的决定而激活时钟是高,以避免错误吗
计数。
终端计数(TCU)和终端倒计时(TCD)输出通常是高的。
当电路已达到计数状态15,第二低
过渡的CPU会导致TCU去低。
TCU都将停留在低水平,直到CPU走高再,重复计数了时钟。
同样,TCD输出将低当电路在零状态和
CPD就低。终端计数的输出可以作为时钟输入信号
下一个高阶电路在多级计数器,因为他们复制时钟信号。
多级计数器将不会完全同步,因为有一个轻微的延迟时间
对每个阶段不同添加,添加。
柜台可以预设的异步并行加载功能的电路。
信息出现在并行数据输入(D0到D3)加载到计数器和
出现在输出(Q0到第三季度)无论条件的时钟输入当
并行加载(PL)输入很低。一个高水平的主复位(MR)输入将
禁用并行加载盖茨,覆盖两个时钟输入和输出.

集成电路(IC)>计数器，除法器>74HC系列/74HC(T)193参考图片

   数量       USD         RMB(含增税）

     1 :          $0.67             ￥4.254
    10 :          $0.591            ￥3.753
    25 :          $0.5224           ￥3.317

企业名：深圳市华永泰科技有限公司

类型：贸易/代理/分销

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