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合成器

合成器资讯

合成器技术

基于FPGA的数字示波器波形合成器研究

引言波形刷新率是评判数字示波器性能优劣的重要指标之一,它直接体现了示波器抓取波形细节的能力,刷新率越高意味着捕获异常的能力越强。目前国内示波器的最高波形刷新率在...

设计应用 时间:2017/12/25 阅读:486

频率合成器的高性能架构实现技术

要满足苛刻的频率合成器要求,通常需要做到一定程度的设计灵活性。基本的锁相环(PLL)频率合成器能以低成本、高空间效率、低功耗封装提供合理的频谱纯度和频率捷变,因此它在射频(RF)系统核心位置发挥作用已经有段时间了。但是,在要求快...

设计应用 时间:2015/5/26 阅读:1113

IDT公司发布全新超低抖动高性能合成器

近日,IDT公司(IDT®)(NASDAQ:IDTI)今天宣布推出具有超低相位抖动的全新高性能合成器8T49NS010,可降低当今串行数据通信系统的误码率。该合成器集成有扇出(fanout)缓冲器/分频器,可为要求苛刻的应用提供高性能的时钟

新品速递 时间:2014/12/4 阅读:1231

ST推出高性能高整合的宽频RF合成器

随着无线标准和频带支援越来越多的应用,意法半导体(STMicroelectronic;ST)推出更符合高性能和高整合度市场需求的STW81200RF合成器。新款STW81200RF合成器采用BiCMOS(SiGe)制造技术,单晶片整合宽频电压控制震

新品速递 时间:2014/10/16 阅读:685

ST打造最灵活的宽带射频合成器STW81200

随着越来越多的无线标准和频带支持越来越多的应用,意法半导体开始支持市场对高性能和高集成度的需求。意法半导体新推出的STW81200射频合成器采用BiCMOS(SiGe)制造技术,...

新品速递 时间:2014/10/8 阅读:833

基于单片机的直接频率数字合成器的设计方案

摘要:本文提出了一种基于单片机的直接频率数字合成器的设计方案。方案采用单片机控制FPGA产生DDS信号输出频率范围为20Hz~20KHz,幅度为0.3V~5V,两路正交信号能够实现0o~359...

技术方案 时间:2014/1/22 阅读:1776

系统时钟发生器设计抉择:PLL合成器与晶振时钟性能比较

现今非常复杂的系统设计可能需要分配几个逻辑标准和几个频率的时钟信号复本。时钟的多个复本可能需要一个扇出缓存用于分配。时钟的频率乘数可能需要一个PLL合成器。所有这些要求可以结合在一个有挑战性的时钟树型设计中。电子系统要求可...

基础电子 时间:2013/3/27 阅读:3215

基于高电压电荷泵的PLL频率合成器设计

锁相环(PLL)频率合成器中的电荷泵电压用于控制VCO的振荡频率。大多数PLL的电荷泵电压一般为5V或6V,因而电荷泵电压可控的VCO频率调谐范围和调谐精度都是有限的。ADI公司推出带高电压电荷泵的PLL频率合成器ADF4113HV.该频率合成器专

技术方案 时间:2013/1/11 阅读:1325

ADI推出业界最快直接数字频率合成器

满足适合无线应用的直接数字频率合成(DDS)技术的要求需要快速跳变和扫描。ADI公司将以前的DDS集成电路(IC)时钟速度提升了三倍以上。ADI公司的AD9914集成了片内高速12-b...

新品速递 时间:2012/7/2 阅读:3388

基于MSP430F499的波形合成器

摘要:以MSP430F499为核心,主要由方波振荡电路、分频与滤波模块、移相电路、放大电路、加法器等组成。将方波振荡器的信号分频滤波产生不同频率的正弦波,经移相放大等处理...

技术方案 时间:2012/2/10 阅读:4775

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