SK 海力士正准备推出“2.5D 扇出”封装作为其下一代存储半导体技术。由于今年在高带宽内存（HBM）领域的成功表现，SK海力士对下一代芯片技术领域充满信心，似乎正在加紧努力，通过开发“”内存产品来确保技术领先地位。
11月26日业内人士透露，SK海力士正准备将2.5D Fan-out封装技术集成到继HBM之后的下一代DRAM中。
这项新技术将两个 DRAM 芯片水平排列，然后将它们组合起来，就像它们是一个芯片一样。一个特征是芯片变得更薄，因为它们下面没有添加基板。这使得信息技术 (IT) 设备中安装的芯片厚度显着减小。SK海力士预计早将于明年公开披露使用这种封装制造的芯片的研究结果。
SK海力士的尝试相当独特，因为2.5D Fan-out封装此前从未在内存行业尝试过。该技术主要应用于先进系统半导体制造领域。全球领先的半导体代工厂台积电于2016年首次将扇出晶圆级封装（FOWLP）商业化，用于生产iPhone的应用处理器，从而获得了苹果的信任。三星电子从今年第四季度开始将这项技术引入到 Galaxy 智能手机的先进 AP 封装中。
SK海力士在存储半导体领域应用扇出封装的一个主要原因被解读为封装成本的降低。业界将2.5D扇出封装视为一种可以通过跳过硅通孔（TSV）工艺同时增加输入/输出（I/O）接口数量来降低成本的技术。业界推测这种封装技术将应用于图形DRAM（GDDR）和其他需要扩展信息I/O的产品。
SK海力士利用这项技术抢占内存产品小批量多样化的IT趋势的战略正在变得更加清晰。SK海力士正在巩固与世界图形处理单元（GPU）公司Nvidia的合作，该公司在HBM市场处于领先地位，该市场作为下一代DRAM而受到关注。还有一个例子是，SK海力士为苹果新AR设备“Vision Pro”中安装的“R1”计算单元生产并提供了特殊DRAM。SK海力士总裁Kwak No-jung表示：“在人工智能时代，我们将把存储半导体创新为针对每个客户的差异化产品。”
谁才是新方向？ 虽然目前业界都在集中研发HBM3的迭代产品，但是厂商们为了争夺市场的话语权，对于未来HBM技术开发有着各自不同的见解与想法。
三星 三星正在研究在中间件中使用光子技术，光子通过链路的速度比电子编码的比特更快，而且耗电量更低。光子链路可以飞秒速度运行。这意味着10-个时间单位，即四十亿分之一（十亿分之一的百万分之一）秒。在近举行的开放计算项目（OCP）峰会上，以工程师李彦为代表的韩国巨头先进封装团队介绍了这一主题。
除了使用光子集成电路外，另一种方法是将 HBM 堆栈更直接地连接到处理器（上图中的三星逻辑图）。这将涉及谨慎的热管理，以防止过热。这意味着随着时间的推移，HBM 堆栈可以升级，以提供更大的容量，但这需要一个涵盖该领域的行业标准才有可能实现。
SK海力士 据韩媒报道，SK海力士还在研究 HBM 与逻辑处理器直接连接的概念。这种概念是在混合使用的半导体中将 GPU 芯片与 HBM 芯片一起制造。芯片制造商将其视为 HBM4 技术，并正在与英伟达和其他逻辑半导体供应商洽谈。这个想法涉及内存和逻辑制造商共同设计芯片，然后由台积电（TSMC）等晶圆厂运营商制造。
这有点类似于内存处理（PIM）的想法，如果终不能成为行业标准的话，很可能会变成事实上的厂商独占。
美光 Tom's Hardware 报道称，美光与市场上的其他公司正在开展 HBM4 和 HBM4e 活动。美光目前正在生产 HBM3e gen-2 内存，采用 8层垂直堆叠的 24GB 芯片。美光的 12 层垂直堆叠 36GB 芯片将于 2024 年第一季度开始出样。它正与半导体代工运营商台积电合作，将其 gen-2 HBM3e 用于人工智能和 HPC 设计应用。
美光表示，其目前的产品具有高能效，对于安装了1000万个GPU的设备来说，每个HBM堆栈能节省约5瓦的功耗，预计五年内将比其他HBM产品节省高达5.5亿美元的运营开支。
下一代HBM 2015年以来，从HBM1到HBM3e，它们都保留了相同的1024位(每个堆栈)接口，即具有以相对适中的时钟速度运行的超宽接口，为了提高内存传输速率，下一代HBM4可能需要对高带宽内存技术进行更实质性的改变，即从更宽的2048位内存接口开始。
出于多种技术原因，业界打算在不增加 HBM 存储器堆栈占用空间的情况下实现这一目标，从而将下一代 HBM 存储器的互连密度提高一倍。HBM4 会在多个层面上实现重大技术飞跃。在 DRAM 堆叠方面，2048 位内存接口需要大幅增加内存堆叠的硅通孔数量。同时，外部芯片接口需要将凸块间距缩小到远小于 55 微米，而 HBM3 目前的凸块总数（约）为 3982 个，因此需要大幅增加微型凸块的总数。
内存厂商表示，他们还将在一个模块中堆叠多达 16 个内存模块，即所谓的 16-Hi 堆叠，从而增加了该技术的复杂性。(从技术上讲，HBM3 也支持 16-Hi 堆叠，但到目前为止，还没有制造商真正使用它）这将使内存供应商能够显著提高其 HBM 堆叠的容量，但也带来了新的复杂性，即如何在不出现缺陷的情况下连接更多的 DRAM 凸块，然后保持所产生的 HBM 堆叠适当且一致地短。
在阿姆斯特丹举行的台积电 OIP 2023 会议上，台积电设计基础设施管理主管这样说道："因为[HBM4]不是将速度提高了一倍，而是将[接口]引脚增加了一倍。这就是为什么我们要与所有三家合作伙伴合作，确保他们的 HBM4（采用我们的先进封装方法）符合标准，并确保 RDL 或 interposer 或任何介于两者之间的产品都能支持（HBM4 的）布局和速度。因此，我们会继续与三星、SK 海力士和美光合作"。
目前，台积电的 3DFabric 存储器联盟目前正致力于确保 HBM3E/HBM3 Gen2 存储器与 CoWoS 封装、12-Hi HBM3/HBM3E 封装与封装、HBM PHY 的 UCIe 以及无缓冲区 HBM（由三星率先推出的一项技术）兼容。
美光公司今年早些时候表示，"HBMNext "内存将于 2026 年左右面世，每堆栈容量介于 36 GB 和 64 GB 之间，每堆栈峰值带宽为 2 TB/s 或更高。所有这些都表明，即使采用更宽的内存总线，内存制造商也不会降低 HBM4 的内存接口时钟频率。
